FPGA在出租車計費器上的應用研究

FPGA在出租車計費器上的應用研究

針對傳統基于單片機的出租車計費器的不足之處,給出了一種利用VHDL硬件描述語言設計基于FPGA的出租車計費系統的方案.該系統具有模擬出租車啟動,停止,暫停等功能,并用動態掃描電路顯示出租車行駛里程、等待時間和所需的費用.通過分析軟件仿真的波形和硬件調試,證明該出租車計費系統具有出租車計費囂的基本功能.由于使用FPGA芯片,具有外圍電路少,成本低等優點,可用于實際的出租車計費系統.

作 者： 焦敏 Jiao min   作者單位： 四川托普信息技術職業學院,611143  刊 名： 中國科技信息  英文刊名： CHINA SCIENCE AND TECHNOLOGY INFORMATION  年，卷(期)： 2009 ""(13)  分類號： U4  關鍵詞： FPGA   VHDL   出租車計費器   maxplusll  

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