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星載FPGA內(nèi)時(shí)序電路設(shè)計(jì)與時(shí)鐘控制技術(shù)分析
在分析星載FPGA內(nèi)時(shí)序電路特性以及FPGA可編程資源特性的基礎(chǔ)上,指出了FPGA內(nèi)同步時(shí)序電路出現(xiàn)時(shí)鐘偏斜現(xiàn)象的機(jī)理.針對(duì)時(shí)鐘偏斜,提出了星載FPGA內(nèi)時(shí)序電路的設(shè)計(jì)準(zhǔn)則.基于設(shè)計(jì)準(zhǔn)則,提出了并行移位寄存器的一種異步化設(shè)計(jì)方法,闡述了在FPGA源代碼中設(shè)置設(shè)計(jì)約束,或在邏輯綜合與布局布線過(guò)程中聯(lián)合設(shè)置設(shè)計(jì)約束,將主要同步時(shí)序電路時(shí)鐘信號(hào)布置在全局時(shí)鐘網(wǎng)絡(luò)上的方法.工程實(shí)踐表明:上述方法很好地解決了星裁FPGA內(nèi)同步時(shí)序電路時(shí)鐘偏斜問(wèn)題,可確保星載FPGA工作的穩(wěn)定性與可靠性.
作 者： 杜文志 DU Wenzhi 作者單位： 北京空間飛行器總體設(shè)計(jì)部,北京,100094 刊 名： 航天器工程 ISTIC 英文刊名： SPACECRAFT ENGINEERING 年，卷(期)： 2008 17(5) 分類號(hào)： V446 關(guān)鍵詞： 星載FPGA 全局時(shí)鐘網(wǎng)絡(luò) 時(shí)序電路 時(shí)鐘偏斜【星載FPGA內(nèi)時(shí)序電路設(shè)計(jì)與時(shí)鐘控制技術(shù)分析】相關(guān)文章：
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